Design Verification Engineer
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Emplacement
Paris75001
Île-de-France
France
Contrat
À plein temps, Durée indéterminéeDate de publication:
2025-06-11Online to:
2025-08-10EUR 20.00 HOUR
Design Verification Engineer
- CIS Electronics Engineering
- Île-de-France
- 1 semaine il y a
I am looking for a front-end Verification engineer for a 6-month contract based in France.
english speakers ok
starting : mid June
skills :
- digital design RTL
- SystemVerilog for complex SoC integration
- FPGA
please apply if you think you are a good fit
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